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fragen über SN74LS673 (Bauelemente)

verfasst von geralds  , Wien, AT, 05.09.2009, 14:36 Uhr
(editiert von geralds am 05.09.2009 um 14:36)

» Hallo
»
» Ein Paar Unklaheiten über 16 bit Register:
»
»
»
»
»
» Wenn ich das richtig verstanden habe, bei der vorletzten Zeile, bei
» fallender Flancke auf "CLK" wird der nächste Ausgang high. Stimmt das
» überhaupt?
»
» Was ist wenn der Register Ausgang "P15" erreicht wird + 1 Clocksignal?
» Fängt es bei "P0" wieder an?
»
» Danke und tschüss

---
Hallo oliblues,

Hier ist die Beschreibung, sollte leicht verständlich sein:
http://focus.ti.com/lit/ds/symlink/sn74ls673.pdf


Gerne geschehen und tschüß
Gerald

--
...und täglich grüßt der PC:
"Drück' ENTER! Feigling!"

Gesamter Thread:

fragen über SN74LS673 - oliblues, 04.09.2009, 14:41 (Bauelemente)

fragen über SN74LS673 - geralds, 05.09.2009, 14:36

fragen über SN74LS673 - oliblues, 07.09.2009, 12:17

fragen über SN74LS673 - geralds, 07.09.2009, 12:53

fragen über SN74LS673 - oliblues, 07.09.2009, 12:57