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Board-AnsichtSpannungsbegrenzung Gate Source FET-PNP (Elektronik)
verfasst von Torsten
, 20.11.2011, 21:08 Uhr
(editiert von Torsten am 20.11.2011 um 21:10)
» und was das Gate abbekommt hängt ganz vom
» Steuersignal und der zu schaltenden Spannung ab.
Noch mal als Nachtrag, weil mich Dein Kommentar wundert, dass der Pegel am Gate von der zu schaltenden Spannung abhängt: Selbstverständlich tut er das und er soll es sogar.
Die Schaltung zieht (bei einer Ansteuerung mit 0/5 V Signalen) das Gate des PMOS entweder gegen VDD oder gegen VDD - 9 V.
Das ist eigentlich der Vorteil der Schaltung, dass der Pegel am Gate einen festen Abstand zu VDD hat.
Gruß
Torsten
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Spannungsbegrenzung Gate Source FET-PNP - Heiko_h, 20.11.2011, 15:19
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